出投笔记 -
全加器是能够计算低位进位的二进制加法电路。。
相加时不考虑进位的二进制加法则称为半加，所用的电路叫做半加器。相加时考虑来自低位的进位以及向高位的进位的二进制加法则称为全加，所用的电路叫做全加器。
全加器除完成加法运算外，还可用来产生组合逻辑函数。若某一逻辑函数的输出恰好等于输入代码表示的数值加上另外一个常数或由同一组输入变量组成的代码时，使用全加器往往会得到十分简单的设计效果。
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一个全加器由两个异或门、三个与门、一个或门构成。S1、T1、T2、T3则是门与门之间的连线。代码显示了用纯结构的建模方式，其中xor 、and、or 是Verilog HDL 内置的门器件。
以 xor x1 (S1, A, B) 该例化语句为例：xor 表明调用一个内置的异或门，器件名称xor ，代码实例化名x1（类似原理图输入方式）。括号内的S1，A，B 表明该器件管脚的实际连接线（信号）的名称，其中 A、B是输入，S1是输出。
参考资料来源：百度百科-一位全加器
参考资料来源：百度百科-全加器
莫妮卡住了 -
能够计算低位进位的二进制加法电路为一位全加器。而半加器电路指对两个输入数据位相加，输出一个结果位和进位，没有进位输入的加法器电路。是实现两个一位二进制数的加法运算电路。
一位全加器可以处理低位进位，并输出本位加法进位。多个一位全加器进行级联可以得到多位全加器。常用二进制四位全加器74LS283。
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一位全加器的表达式如下：
Si=Ai⊕Bi⊕Ci-1
第二个表达式也可用一个异或门来代替或门对其中两个输入信号进行求和：
半加器没有接收进位的输入端，全加器有进位输入端，在将两个多位二进制数相加时，除了最低位外，每一位都要考虑来自低位的进位，半加器则不用考虑，只需要考虑两个输入端相加即可。
半加器有两个输入和两个输出，输入可以标识为 A、B 或 X、Y，输出通常标识为合 S 和进制 C。A 和 B 经 XOR 运算后即为 S，经 AND 运算后即为 C。
全加器引入了进制值的输入，以计算较大的数。为区分全加器的两个进制线，在输入端的记作 Ci 或 Cin，在输出端的则记作 Co 或 Cout。半加器简写为 H.A.，全加器简写为 F.A.。
半加器：半加器的电路图半加器有两个二进制的输入，其将输入的值相加，并输出结果到和（Sum）和进制（Carry）。半加器虽能产生进制值，但半加器本身并不能处理进制值。
全加器：全加器三个二进制的输入，其中一个是进制值的输入，所以全加器可以处理进制值。全加器可以用两个半加器组合而成。
参考资料来源：百度百科-一位全加器
参考资料来源：百度百科-全加器
参考资料来源：百度百科-半加器
参考资料来源：百度百科-加法器
阳光下的日耳曼尼亚 -
一位全加器是指：两个一位二进制数带有进位的加法器。二进制表示中只有0和1。
比如设：两个加数A和B，低位的进位是C，和为S，进位是Cin，则{Cin，S}=A+B+C。
例如：A B C Cin S
0 0 0 0 0
1 0 0 0 1
1 1 0 1 0
1 0 1 1 0
1 1 1 1 1
……
相对全加器，还有半加器，这是不考虑进位的加法器，此时只有加数A、B及和S。S=A+B
例如：A B S
0 0 0
1 0 1
0 1 1
1 1 0
相对于一位加法器，还有两位、三位、四位、等多位加法器，此时要从低位向高位依次进行一位全加器的计算，当然通过提前进位的方式可以减少计算的时间，详细参考资料
左迁 -
所有的全加器，都是“一位”的。
难道还有“两位”的全加器？
多位的，就不是“全加器”了，而是“加法器”。
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全加器、半加器，都是进行二进制数相加运算的。
区别在于：
半加器，是【两个】一位的二进制数相加；
全加器，是【三个】一位的二进制数相加。
（因此，半加器，也可以用全加器代替。）
两个四位二进制数 A、B 相加的示意图如下：
在最低位，只有两个一位数相加，然后产生 C（Carry）以及 S（sum）。
仅有两个一位数相加，这就可以用“半加器”完成。
在其它位，都是三个一位数相加，同样会产生 C（进位）以及 S（和）。
三个一位数相加，这就必须用“全加器”来实现了。
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它们的真值表以及逻辑表达式，在图中，都已给出。
它们的逻辑电路，当然可以用“门电路”组成。
但是，半加器、全加器，都有自己的逻辑符号，如图所示。
再用“门电路”来画电路图，就没有必要了。
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把 n 个全加器串联起来，就可以组成【n 位加法器】。
4 位加法器的集成电路是“74LS283”，它的功能是：
A3A2A1A0 + B3B2B1B0 + C0 → C4 S3S2S1S0。
把两个 74LS283 级联起来，就可以组成 8 位的加法器。
当然，还可以继续级联。。。
陶小凡 -
FA (Full-Adder) 全加器，全加器是实现两个一位二进制数及低位来的进位数相加（即将三个二进制数相加），求得和数及向高位进位的逻辑电路。所以全加器有三个输入端（Ai，Bi，Ci）和两个输出端Si，Ci+1）。